最专业的FPGA ZYNQ论坛--黑金动力社区

 找回密码
 注册
查看: 122|回复: 0

为什么时钟为50Mhz的FPGA可以**GMII 125MHz的数据?

[复制链接]
zbc728 发表于 2018-11-27 12:06:48 | 显示全部楼层 |阅读模式

马上注册,结交更多好友,享用更多功能,让你轻松玩转社区。

您需要 登录 才可以下载或查看,没有帐号?注册

x
我对Ethernet_test.v模块中有一些疑问:
1. "assign e_gtxc=e_rxc"使得e_gtxc的时钟是多少?前面写的是"input e_rxc, //125Mhz ethernet gmii rx clock"和"output e_gtxc, //25Mhz ethernet gmii tx clock",那assigh之后e_gtxc时钟为什么会变成25M?
2. 如果PHY**e_rxd的周期是125MHz(千兆以太网),为什么时钟速率为50MHz的FPGA能够**其数据?
您需要登录后才可以回帖 登录 | 注册

本版积分规则

QQ|@2009-2016 芯驿电子科技(上海)有限公司|小黑屋|手机版|Archiver|黑金动力社区 ( 沪ICP备11013590沪公网安备 31011702000003号

GMT+8, 2018-12-15 11:23 , Processed in 0.066532 second(s), 19 queries , Gzip On.

Powered by Discuz! X3.2

© 2001-2013 Comsenz Inc.

快速回复 返回顶部 返回列表